A digital CMOS design technique for SEU hardening
2000 ◽
Vol 47
(6)
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pp. 2603-2608
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2006 ◽
Vol E89-A
(4)
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pp. 1076-1087
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Keyword(s):
2000 ◽
2002 ◽
Vol 10
(5)
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pp. 601-607
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2014 ◽
Vol 134
(5)
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pp. 283-283